[기산전자주식회사] Embeded F/W 개발 및 FPGA Logic 개발

경력: 경력 5~10년

학력: 대졸(4년제) 이상 관련 전공

근무형태: 정규직 수습기간 3개월

급여: 면접 후 결정

직급/직책: 책임연구원, 선임연구원

근무일시: 주 5일(월~금) 오전 9시~오후 6시

근무지역: 서울 성동구

최저임금계산에 대한 알림 하단에 명시된 급여, 근무 내용 등이 최저임금에 미달하는 경우 위 내용이 우선합니다. 본 채용정보는 2024년 1월 1일 부터는 2024년 최저임금을 준수 합니다.

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Embeded F/W 개발 및 FPGA Logic 개발

기산전자 주식회사는 지폐 인식과 위조 감별이라는 금융사무기기에 필수적인 핵심기술을 축적하고 향상시켜 왔으며, 이 기술을 바탕으로 지폐분류정사기를 개발, 전세계 50여개 국가 은행 및 금융권에 판매를 하고 있습니다. 당사 제품은 우수한 기술력을 인정받아 2011년 지폐분류 정사기가 세계일류상품으로 지정되었고, 현재 국내 및 러시아, 유럽권 등의 국가에서 제 1의 시장점유율을 형성하고 있습니다. 당사는 연구개발에 역량을 더욱 더 집중하여 다양한 금융사무기기를 개발, 세계일류의 금융종합 사무기기 제조회사로 성장할 것입니다.

모집부문 및 상세내용

모집부문

상세내용

공통 자격요건

ㆍ학력 : 대졸 이상 (4년) - 석사우대

ㆍ나이/성별 : 무관

Embeded F/W 개발 및 FPGA Logic 개발기술연구소 0명

담당업무

ㆍEmbeded F/W 개발 및 FPGA Logic 개발

지원자격

ㆍ경력 : 경력 5년 ~ 10년(책임연구원, 선임연구원급)
DSP F/W 개발 경험자
FPGA 개발 경험자

근무조건

ㆍ근무형태:정규직(수습기간)-3개월

ㆍ근무일시:주 5일(월~금) 오전 9시~오후 6시

ㆍ급여:면접후 결정

ㆍ근무지역:(133-831) 서울 성동구 성수2가3동 273-1 - 서울 2호선 성수 에서 500m 이내

전형절차

서류전형
1차면접
2차면접
최종합격

접수기간 및 방법

ㆍ접수기간:2021년 3월 3일 (수) 15시 ~ 2021년 4월 18일 (일) 24시

ㆍ접수방법:사람인 입사지원

ㆍ이력서양식:사람인 온라인 이력서

유의사항

ㆍ입사지원 서류에 허위사실이 발견될 경우, 채용확정 이후라도 채용이 취소될 수 있습니다.

복리후생

지원금/보험: 건강검진, 각종 경조사 지원, 단체 상해보험

급여제도: 퇴직연금, 인센티브제, 장기근속자 포상, 우수사원포상, 퇴직금, 성과급, 야근수당,...

선물: 명절선물/귀향비, 창립일선물지급, 생일선물/파티, 결혼기념일선물

교육/생활: 창립일행사, 우수사원시상식, 워크샵, 신규 입사자 교육(OJT), 직무능력향상교육, 리...

근무 환경: 휴게실, 회의실, 카페테리아, 전용 사옥, 사내 정원, 유니폼지급, 사무용품 지급

조직문화: 자유복장

출퇴근: 주차장제공

리프레시: 연차, 경조휴가제, 반차, Refresh휴가, 창립일휴무, 근로자의 날 휴무, 포상휴가, 산전...

근무지위치

(133-831) 서울 성동구 성수2가3동 273-1 서울 2호선 성수역에서 500m 이내

지도 보기

접수기간 및 방법

마감되었습니다.

시작일: 2021.03.03 15:00
마감일: 2021.04.18 23:59

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인담자 톡

기산전자주식회사 인사담당자님이 1개의 질문에 답변한 내용입니다. 21.03.03 15:38

Q1.근무 환경은 어떤가요?: 내근 100%; 자율 복장; 월 1회 회식; 근속연수 8~9년; 대부분 30·40대

기업정보

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